Patent DE 10 2013 114 046
Elektronische Verzögerungsschaltung in CMOS-Technologie
Elektronische Verzögerungsschaltung in CMOS-Technologie zur Abgabe eines gegenüber einem Eingangssignal (IN) zeitlich verzögerten Ausgangssignals (OUT/OUTB) umfassend:
- einen aus mindestens zwei Transistoren (M3, M6) gebildeten CMOS-Thyristor-Primärschalter, dessen am Schaltausgang auftretendes Schaltsignal (VT) einem Sekundärschalter zugeführt ist, welcher das Ausgangssignal (OUT/OUTB) abgibt;
- einen Integrationskondensator (C0), der zwischen einer Versorgungsspannung (VDD) und einem Knoten (VCAP), welcher die Gate-Elektrode des einen Transistors (M6) mit der Drain-Elektrode des anderen Transistors (M3) des Primärschalters verbindet, geschaltet ist und der über ein Entlademittel (M2) entladen werden kann;
- einen Schalter (M4), der das Eingangssignal (IN) empfängt und der dem Schalten des Entlademittels (M2) dient;
- Rücksetzelemente (M5, M7) zum Rücksetzen des Primärschalters (M3, M6) nach dem Wechsel das Ausgangssignals; dadurch gekennzeichnet, dass am Schaltausgang (VT) des Primärschalters (M3, M6) ein zusätzlich angeschaltetes Bauelement als ein Ableitelement (C1; M9) zur Ableitung des Sub-Threshold-Stromes des Primärschalters (M3, M6) angeordnet ist.
Patent-Nr.:DE 10 2013 114 046
Erfinder:Benjamin Saft. Eric Schäfer. André Jäger
Anwendung:
Verzögerungselemente als Bestandteil integrierter Schaltungen in energieautarken SystemenForschungsfeld:Integrierte Sensorsysteme
erteiltes Patent
Anmeldetag:13.12.2013
Tag der Veröffentlichung:18.06.2015
Tag der Erteilung:24.12.2015
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